Page 34 - 网络电信2023年10月刊
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4.2.2接收端测试 五、结论
FPGA通过GPIO接收可见光接收模块输出的数据，该数据首 本文提出了一种基于FPGA的多通道可见光通信系统架构，
先通过CDR技术完成 比特流的恢复，随后经同步头捕获、串并 系统架构分为发射端与接收端，其中，发送端将接收到的以太
转换、8B10B解码、RS解码、透传解码后，各个可见光通道恢 网MAC数据以帧为单位分配到各个可见光发射链路上。各发射链
复出发射端的原始数据并合为一路数据。图14为接收端测试结 路接收到MAC数据帧后，经过透传组帧、码块分割、RS编码、
果，其中，rx_tdata为接收到的数据，rx_tlast信号拉高时表 8B10B编码、串并转换、添加同步头后，即完成方波调制模式
示数据接收完成；rx_tready信号拉高时表示处于数据接收状 的所有处理，通过FPGA的GPIO将数据发射给可见光发射模块。
态；rx_tvalid信号拉高时表示接收的数据有效。从图中可以 接收端的FPGA通过GPIO接收可见光接收模块输出的数据。该数
看出，接收的最终数据与发射端的以太网 MAC帧原始数据皆为 据首先通过CDR技术完成比特流的恢复，随后经同步头捕获、串
30~39 的重复数，验证了该系统的准确性。 并转换、8B10B解码、RS解码、透传解码后，恢复出以太网MAC
帧。经测试，该系统最大能支持16通道的数据传输，且单通道
图14 接收端测试结果
的传输速率不小于30Mb/s，丢包率为0%，验证了该系统具备高
速性、准确性和可靠性。
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Jperf软件接收数据并统计接收的速率。图15为系统单通道传 [6] WANG F, LIU C, WANG Q, et al. Secrecy analysis of
generalized space-shift keying aided visible light
输测试截图，其中，图15（a）为发送端速率测试结果，图15
communication[J]. IEEE Access, 2018, 6:18310-18324.
（b）为接收端速率测试结果，从图中可以看出单通道传输速率 [7] CHI N, ZHOU Y, LIANG S, et al. Enabling technolo‐ gies
为34 786kb/s，丢包率为0%，验证了系统的高速性与可靠性。 for high-speed visible light communication employing
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